锁相环

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PLL
·锁相环（PLLs）：支持系统时钟发生、处理和分配 ·8个LED和4个开关：提供简易输入输出系统
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phase-locked loop
...论文|计算机毕业设计关键词:射频，锁相环，频率合成器，相位噪声，环路滤波器 [gap=1406]Key words: Radio, phase-locked loop(PLL), frequency synthesizer, phase noise, Loop filter ...
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Phase Lock Loop
...刊文摘-论文中国于低信噪比环境下的码延迟锁定环(Delay Lock Loops,DLL)鉴别器(超前减滞后鉴别器)和载波锁相环(Phase Lock Loops,PLL)鉴别器(二象反正切鉴别器):基于最优闭环传递函数,设计了二阶和三阶跟踪环数字环路滤波器的参数;..
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DPLL
23全数字锁相环 全数字锁相环（ADPLL）是完全的数字系统。首先，数字意味着这个系统只含有逻辑器件，而且数字还意味着整个系统里的全部信号都是数字的。

短语

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在本文中，我们将展现一个新的锁相环锁定检测方法。
In this paper, a new method of PLL lock detector will be presented.
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在通信领域中，锁相环频率合成器起着越来越重要的角色。
In the field of communications, PLL synthesizers playing an increasingly important role.
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为了尽量减少抖动的锁相环，建议，以避免在测试输出的积极信号。
In order to minimize the PLL jitter, it is recommended to avoid active signal on the TEST output.

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